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由于受諸多因素的影響，片上多核處理器(Chip Multiprocessor，CMP)，又稱多核微處理器，已成為構造現代高性能微處理器的技術途徑，是處理器發展的必然趨勢。本書是講授多核體系結構設計和優化的本著作。

通過對LLCMP與傳統單處理器的優缺點，本書仔細研究了如何針對兩種常見但截然不同的工作負載來更好地設計CMP：高度并行且對吞吐率敏感的應用和并行度較低但對延遲敏感的應用。對吞吐率敏感的應用，如可迅速處理多個獨立事務的服務器工作負載，需要綜合考慮CMP中所有可能限制吞吐率的部件，如處理器核心、片上緩存和片外存儲器接口。對延遲敏感的應用，如桌面應用，其關注的焦點是如何降低內核間的通信延遲，以及如何幫助程序員簡化已有程序代碼的多線程化。書中介紹了多種可用于CMP系統的并行編程的技巧，并重點討論了斯坦福大學在該領域的相關研究工作。本書還關注了線程級猜測(Thread-level Speculation，TLS)和事務型內存(Transactional Memory)。TLS是一種將標準的串行程序自動切分成CMP上多個并行線程的方法。事務型內存模型使用硬件而非傳統軟件鎖機制來保障一段指令的原子代碼執行，可以顯著減少并行編程的工作量，降低并行代碼的出錯概率。通過閱讀本書，讀者可以在較短時間內熟悉和掌握片上多處理器研究的主流技術和的研究成果，為片上多處理器領域的科研和應用帶來新的思路和靈感。