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深入理解OpenRISC體系結(jié)構(gòu)圖書(shū)
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深入理解OpenRISC體系結(jié)構(gòu)

甄建勇編著的《深入理解OpenRISC體系結(jié)構(gòu)》是一本介紹OpenRISC體系結(jié)構(gòu)的圖書(shū)。通過(guò)閱讀本書(shū),讀者不僅可以獲得計(jì)算機(jī)體系結(jié)構(gòu)設(shè)計(jì)的基礎(chǔ)理論知識(shí)。還可以掌握動(dòng)手設(shè)計(jì)處理器的基本技能,邁人CPU設(shè)計(jì)的大門, 本書(shū)...

內(nèi)容簡(jiǎn)介

甄建勇編著的《深入理解OpenRISC體系結(jié)構(gòu)》是一本介紹OpenRISC體系結(jié)構(gòu)的圖書(shū)。通過(guò)閱讀本書(shū),讀者不僅可以獲得計(jì)算機(jī)體系結(jié)構(gòu)設(shè)計(jì)的基礎(chǔ)理論知識(shí)。還可以掌握動(dòng)手設(shè)計(jì)處理器的基本技能,邁人CPU設(shè)計(jì)的大門, 本書(shū)大致可分為三部分,即知識(shí)儲(chǔ)備、實(shí)例分析和動(dòng)手實(shí)踐。其中部分著重介紹了體系結(jié)構(gòu)設(shè)計(jì)中的概念、并行技術(shù)、局部性原理,以及進(jìn)行計(jì)算機(jī)體系結(jié)構(gòu)設(shè)計(jì)的一般流程。第二部分以O(shè)penRISC為分析對(duì)象,深入分析了開(kāi)源CPU數(shù)據(jù)通路、控制通路和存儲(chǔ)器層次組織的實(shí)際實(shí)現(xiàn),對(duì)研究體系結(jié)構(gòu)設(shè)計(jì)具有很高的現(xiàn)實(shí)意義和實(shí)踐價(jià)值。此外本部分還介紹了以O(shè)penRISC為基礎(chǔ)的ORPSoC的很多設(shè)計(jì)細(xì)節(jié)。第三部分介紹如何運(yùn)用前面的積累設(shè)計(jì)一個(gè)簡(jiǎn)單的RISC核,以及設(shè)計(jì)的仿真和FPGA驗(yàn)證。 本書(shū)適合急于了解和掌握體系結(jié)構(gòu)設(shè)計(jì)基礎(chǔ),對(duì)開(kāi)源CPU內(nèi)部實(shí)現(xiàn)充滿好奇,并想動(dòng)手設(shè)計(jì)屬于自己的CPU的讀者,以及從事嵌入式開(kāi)發(fā)的技術(shù)人員。此外,本書(shū)還可作為對(duì)計(jì)算機(jī)體系結(jié)構(gòu)設(shè)計(jì)感興趣的電子工程類、自動(dòng)控制類、計(jì)算機(jī)類的高年級(jí)本科生和研究生的參考用書(shū)。

作者簡(jiǎn)介

甄建勇,嵌入式驅(qū)動(dòng)工程師,芯片設(shè)計(jì)工程師,曾在中科院體系結(jié)構(gòu)重點(diǎn)實(shí)驗(yàn)室工作。現(xiàn)供職君正集成電路,負(fù)責(zé)芯片架構(gòu)設(shè)計(jì)。長(zhǎng)期專注于嵌入式設(shè)備驅(qū)動(dòng)開(kāi)發(fā)和數(shù)字電路設(shè)計(jì),并積累了大量理論和工程經(jīng)驗(yàn)。一直以開(kāi)源軟件和開(kāi)源硬件的發(fā)展為己任,是開(kāi)源處理器OpenRISC的實(shí)踐者和推動(dòng)者。2010年開(kāi)始關(guān)注Opencores組織的OpenRISC開(kāi)源體系結(jié)構(gòu),并在2013年年初在CSDN網(wǎng)站開(kāi)設(shè)了OpenRISC專欄,以"關(guān)注OpenRISC開(kāi)源體系結(jié)構(gòu)的發(fā)展,研究OpenRISC的Verilog HDL源碼,討論學(xué)習(xí)OpenRISC中遇到的各種問(wèn)題"為宗旨,短時(shí)間內(nèi)就吸引了成千上萬(wàn)的點(diǎn)擊量和回復(fù)。

目錄

前言

章 緒論

1.1 概述

1.2 計(jì)算機(jī)漫談

1.2.1 十進(jìn)制計(jì)算機(jī)

1.2.2 二進(jìn)制計(jì)算機(jī)

1.3 計(jì)算機(jī)體系結(jié)構(gòu)

1.3.1 圖靈與圖靈機(jī)

1.3.2 馮.諾依曼與馮.諾依曼體系結(jié)構(gòu)

1.3.3 改進(jìn)的哈佛體系結(jié)構(gòu)

1.3.4 發(fā)展趨勢(shì)

1.4 并行技術(shù)

1.4.1 流水線

1.4.2 亂序

1.4.4 單指令多數(shù)據(jù)流

1.4.5 同時(shí)多線程

1.4.6 單芯片多處理器

1.4.7 對(duì)稱多處理器

1.5 局部性原理

1.6 計(jì)算機(jī)的評(píng)價(jià)

1.7 設(shè)計(jì)流程

1.7.1 分析

1.7.2 模擬器

1.7.3 FPGA設(shè)計(jì)

1.7.4 ASIC

1.8 OpenRISC

1.8.1 概述

1.8.2 OpenRISC寄存器集

1.8.3 OpenRISC指令集

1.9 小結(jié)

1.10 習(xí)題

第2章 基于OpenRISC的開(kāi)發(fā)

2.1 概述

2.2 項(xiàng)目描述

2.3 開(kāi)發(fā)環(huán)境的構(gòu)建

2.3.1 開(kāi)發(fā)環(huán)境的組成

2.3.2 開(kāi)發(fā)環(huán)境的選擇與安裝

2.4 硬件的開(kāi)發(fā)

2.4.1 模塊劃分和編碼實(shí)現(xiàn)

2.4.2 功能仿真與時(shí)序仿真

2.5 驅(qū)動(dòng)程序的開(kāi)發(fā)

2.6 FPGA板級(jí)驗(yàn)證

2.7 硬件與軟件的比較

2.8 ORPSoC與or1200

2.8.1 ORPSoC架構(gòu)分析

2.8.2 ORPSoC的啟動(dòng)過(guò)程

2.8.3 or1200

2.9 小結(jié)

2.10 習(xí)題

第3章 數(shù)據(jù)通路設(shè)計(jì)

3.1 概述

3.2 數(shù)據(jù)通路

3.3 OpenRISC的數(shù)據(jù)通路整體架構(gòu)分析

3.4 取指

3.5 譯碼

3.6 執(zhí)行

3.6.1 運(yùn)算部件基礎(chǔ)

3.6.2 or1200的運(yùn)算部件

3.7 訪存

3.7.1 流水線的訪存階段

3.7.2 or1200訪存階段的具體實(shí)現(xiàn)分析

3.8 寫回

3.8.1 or1200寫回階段整體功能

3.8.2 or1200寫回階段具體實(shí)現(xiàn)代碼分析

3.9 設(shè)計(jì)一個(gè)簡(jiǎn)單的除法器

3.10 小結(jié)

3.11 習(xí)題

第4章 控制通路設(shè)計(jì)

4.1 概述

4.2 控制通路的復(fù)雜性

4.3 OR的控制通路設(shè)計(jì)分析

4.3.1 整體介紹

4.3.2 sprs模塊

4.4 OR的異常處理

4.4.1 except模塊

4.4.2 freeze模塊

4.5 OR的調(diào)試系統(tǒng)

4.5.1 調(diào)試方案的分類

4.5.2 advanceddebugsystem

4.5.3 我的調(diào)試系統(tǒng)

4.5.4 JTAG模塊

4.6 基于or1200的中斷實(shí)驗(yàn)

4.7 小結(jié)

4.8 習(xí)題

第5章 存儲(chǔ)器組織

5.1 概述

5.2 TLB與Cache

5.2.1 概述

5.2.2 TLB

5.2.3 Cache

5.3 OR的存儲(chǔ)器組織

5.3.1 OR的MMU

5.3.2 OR的Cache

5.4 自己設(shè)計(jì)一個(gè)簡(jiǎn)單的Cache

5.5 小結(jié)

5.6 習(xí)題

第6章 自己設(shè)計(jì)一個(gè)簡(jiǎn)單的CPU

6.1 概述

6.2 層次建模

6.3 可綜合代碼風(fēng)格

6.4 一個(gè)簡(jiǎn)單CPU的設(shè)計(jì)、實(shí)現(xiàn)、仿真與綜合

6.4.1 架構(gòu)設(shè)計(jì)

6.4.2 模塊劃分

6.4.3 模塊劃分與接口定義

6.4.4 RTL實(shí)現(xiàn)

6.4.5 ModelSim仿真

6.4.6 綜合

6.4.7 改進(jìn)及優(yōu)化

6.4.8 tiny_core的指令集

6.5 小結(jié)

6.6 習(xí)題

附錄A 常用公式和定律

附錄B wishbone

附錄C 狀態(tài)機(jī)的4種寫法

附錄D 跨時(shí)鐘域信號(hào)的同步

附錄E 閱讀

參考文獻(xiàn)

后記

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